超声波气体流量计研发探讨 七十四

VHDL语言具有多层次描述系统硬件功能的能力，可从系统的数学模型到门级电路。VHDL语言标准、规范、易于共享和复用。VHDL语言支持大规模复杂的数字系统设计，其核心是层次化设计方法。VHDL语言对层次化设计的支持机制为：库、程序包、可重用的元件及元件例化。库用来存放可编译的设计单元。程序包中说明共用的数据类型、常量、元件和子程序。元件是对VHDL模块的说明，它能在其它模块中被调用。元件例化语句是高层设计调用低层元件的主要手段。

4．2．4元件例化设计在本系统中的实现

元件例化就是引入一种连接关系，将预计设计好的设计实体定义为一个元件，然后利用特定的语句将此元件与当前设计实体中的指定端口连接，从而为当前设计实体引进一个新的低一级的设计层次。在这里，当前设计实体相当于一个较大的电路系统，所定义的例化元件相当予～个要插在这个电路系统板上的芯片，而当前设计实体中指定的端口则相当于这块电路板上准备接受芯片的插座。元件例化是使VHDL设计实体构成自上而下层次化设计的一种重要途径。

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